单击此处编辑母版标题样式单击此处编辑母版文本样式第二级第三级第四级第五级EDA 技术实用教程第 2 章 EDA设计流程及其工具 EDA设计流程及其工具 本章首先介绍FPGACPLD开发和ASIC设计的流程然后分别介绍与这些设计流程中各环节相关的EDA工具软件最后就QUartus Ⅱ的基本情况和EDA重要模块IP作一简述 FPGACPLD设计流程应用CPLD的ED
电子技术综合实验(EDA)实验报告姓 名 班 级 学 号 实验目的:1掌握多位计数器相连的设计方法2掌握十进制六十进制和二十四进制计数器的设计方法3巩固数码管的驱动原理及编程方法4掌握CPLD技术的层次化设计方法实验要求:基本要求:设计一个综合性的计时系统要求能实现时分秒计
单击此处编辑母版标题样式单击此处编辑母版文本样式第二级第三级第四级第五级QUARTUS II 使用入门 邬杨波2008年11月1 QUARTUS II软件简介 Quartus?II是Altera推出的CPLDFPGA开发工具Quartus?II提供了完全集成且与电路结构无关的开发包环境具有数字逻辑设计的全部特性包括: 可利用原理图 结构框图VerilogHDLAHDL和VHDL完成电
成绩 课 程 设 计 说 明 书课程设计名称: EDA技术课程设计 题 目: 字符液晶显示的CPLD实现 学 生 姓 名: 专 业: 学 号: 指 导 教 师: 日期:2
组合逻辑3-8译码器的设计(MaxplusII软件的基本操作与应用)说明:本书将以实验一为例详细介绍AlteraMaxplusII 版本软件的基本应用其它实验将不再赘述读者在通过本实验后将对MaxplusII软件及CPLD的设计与应用有一个比较完整的概念和思路在此因篇幅有限仅仅介绍了MaxplusII软件的最基本最常用的一些基本功能相信读者在熟练使用本软件以后你会发现该软件还有好多非常方
宁夏大学新华学院课程论文(设计)论文题目: 序列检测器设计 姓 名: 于俞 专 业: 电子信息工程 指导教师: 马玉韬
适用多功能数字钟摘 要:Verilog是广泛应用的硬件描述语言可以用在硬件设计流程的建模综合和模拟等多个阶段随着硬件设计规模的不断扩大应用硬件描述语言进行描述的CPLD结构成为设计专用集成电路和其他集成电路的主流通过应用Verilog HDL对适用多功能数字钟的设计达到对Verilog HDL的理解同时对CPLD器件进行简要了解本文的研究内容包括:应用Verilog HDL对适用多功能数字