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#数字锁相环# 相关文档

  • 基于FPGA的数字锁相环的设计.doc

    目 录 MACROBUTTON InsertCrossReference  TOC o 1-3 h z u  HYPERLINK l _Toc327429343 第一章 绪 论 PAGEREF _Toc327429343 h 1 HYPERLINK l _Toc327429344  锁相环技术的发展及研究现状 PAGEREF _Toc327429344 h 

    日期:2022-04-24 格式:.docx 页数:20页 大小:1.95MB 发布:
  • 实验二数字锁相环实验报告.doc

    实验二??数字锁相环一.实验目的?????????????????1.?了解数字锁相环的基本概念2.?熟悉数字锁相环与模拟锁相环的指标3.?掌握全数字锁相环的设计二.实验仪器1.ZH5001通信原理综合实验系统????????????? 一台2.20MHz双踪示波器??????????????????????????一台3.函数信号发生器???????????????????????????

    日期:2022-04-23 格式:.docx 页数:7页 大小:325KB 发布:
  • 数字锁相环实验报告.docx

    上图为锁定状态下用示波器测量: 上图为数字锁相环相位抖动特性测量TPMZ03 与TPMZ02的结果看到两波形 用示波器测量TPMZ02的结果:观察的上升沿完全对齐 到其上升沿较粗上图为待测点(TPMZ01)的输出时钟 上图为待测点(TPMZ02)的输出时钟看到此时频率大小为55.56KHz

    日期:2022-04-23 格式:.docx 页数:2页 大小:105.57KB 发布:
  • 数字锁相环的频率合成及其systemview仿真.doc

    1 绪论 引言锁相环(Phase Lock Loop)简称PLL是一种利用外部输入的参考信号控制环路内部振荡信号反馈控制电路他的被控制量是相位被控对象是压控振荡器如果锁相环路中压控振荡器的输出信号频率发生变化则输入到相位比较器的信号相位θv(t)和θR(t)必然会不同使相位比较器输出一个与相位误差成比例的误差电压Vd(t)经环路滤波器输出一个缓慢变化的直流电压Vc(t)来控制压控振荡器输出信

    日期:2022-04-24 格式:.docx 页数:17页 大小:616.74KB 发布:
  • 基于Matlab的数字锁相环的仿真设计.doc

    基于Matlab的数字锁相环的仿真设计摘 要:锁相环是一个能够跟踪输入信号相位变化的闭环自动跟踪系统它广泛应用于无线电的各个领域并且现在已成为通信雷达导航电子仪器等设备中不可缺少的一部分然而由于锁相环设计的复杂性用SPICE对锁相环进行仿真数据量大仿真时间长而且需进行多次仿真以提取设计参数设计周期长本文借助于Matlab中Simulink仿真软件的灵活性直观性在Simulink中利用仿真模

    日期:2022-04-20 格式:.docx 页数:21页 大小:408KB 发布:
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