VHDL语言实例例1:设计一七段显示译码器用它来驱动七段发光管LED显示十六进制数字0到9和字母A到FLED显示数码管为共阳极LIBRARY ieee ??????????????????????????????? USE ieee.std_logic_1164.all ????ENTITY HEX2LED IS ????????????????????????????? PORT( ???
单击此处编辑母版标题样式单击此处编辑母版文本样式第二级第三级第四级第五级VHDL设计应用实例VHDL设计应用实例1 8位加法器的设计2 8位乘法器的设计3 序列检测器的设计4 正负脉宽数控调制信号发生器的设计5 数字频率计的设计6 秒表的设计7 MCS–51单片机与FPGACPLD总线接口逻辑设计8 交通灯信号控制器的设计9 语音信箱控制系统的设计10 PID控制器的设计11
VHDL语言实验指导书指导老师:胡仕刚湖南科技大学信息与电气工程学院实验一 软件环境的熟悉与了解实验目的熟悉软件编程环境熟练使用max-plus2软件的各项功能在软件上调用各项已编译好的VHDL语言程序参考熟悉VHDL语言编程的格式实验内容学习实验指导书中具体步骤及过程参考完成相应内容输入一个简单的VHDL语言程序对程序进行编译调试将编译通过的文件进行仿真观察仿真结果具体步骤及过程参考以一个最简单
________________________________________________________________________________________________________________________________________________________重新回忆例6-11 一位全加器结构描述library ieeeuse _logic_entity
1与或非2触发器(RSDTJK)3编码器(2-10编码器4位二进制优先编码器)4译码器(2-4译码器3-8译码器7段数码管译码器)5半加器全加器(4位)6减法器7数据选择器(4选1)8序列检测器(检测1110010 ) 9锁存器10移位寄存器(4位)11循环计数器(5进制加法计数减法计数)自己亲手安装破解quartusII软件学会搭建FPGA开发设计环境熟悉软件环境学习FPGA设计方法:原理图方式
数字集成电路设计结课总结 电科11级3班 :卢文东
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