目录 TOC o 1-3 h z u HYPERLINK l _Toc359329933 摘 要 PAGEREF _Toc359329933 h II HYPERLINK l _Toc359329934 Abstract PAGEREF _Toc359329934 h III HYPERLINK l _Toc359329935 引言 PAGEREF _T
2006 年 9 月
目录 TOC o 1-2 h z HYPERLINK l _Toc138156585 引 言 PAGEREF _Toc138156585 h 5 HYPERLINK l _Toc138156586 第一章 FPGA的设计流程 PAGEREF _Toc138156586 h 6 HYPERLINK l _Toc138156587 FPGA概述 PAG
基于FPGA的MSK调制器设计与实现谢丽君1 谭立志2 (1.长沙职业技术学院 湖南 长沙 4100032.株洲职业技术学院 湖南 株洲 412001)摘要:介绍了MSK信号的优点并分析了其实现原理提出一种MSK高性能数字调制器的FPGA实现方案采用自顶向下的设计思想将系统分成串并变换器差分编码器数控振荡器移相器乘法电路和加法电路等六大模块重点论述了串并变换差分编码数控振荡器的实现用原理图输入VH
本科毕业论文(设计)题 目 基于FPGA信号发生器的设计与实现 院(系) 电子工程与电气自动化学院 专 业 电子科学与技术 学生 何厥亚 学 号 09026009 指导教师 常红霞 职称
郑州轻工业学院可编程数字系统设计 题 目 基于FPGA的I2C接口程序实现学生 吕 彦 梅 专业班级 电子信息工程10-2班 学 号 541001030221 院 (系) 电气信息工程学院
西安邮电学院计算机系1 Quartus Ⅱ 用户界面西安邮电学院计算机系时序分析主要内容:创建工程图形输入文本输入 设计的输入 - 图形输入西安邮电学院计算机系 设计的输入 - NOTES西安邮电学院计算机系16202333选择菜单【Assignments】-【Settings】对话框Category中的Fitter Settings选项则可进行时序驱动编译选项Fitter等级工程范围的Fitte
基于FPGA的计算器设计摘 要本文介绍了一个简单计算器的设计该设计采用了现场可编程逻辑器件FPGA设计并基于硬件描述语言VHDL在Altera的Quartus Ⅱ软件上实现仿真系统由计算部分存储部分显示部分和输入部分四个部分组成计算部分为加法器减法器乘法器和除法器存储部分需要3个存储器来实现:内部累加器(acc)输入寄存器(reg)以及结果暂存器(ans)显示部分由四个七段译码管组成分
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