大桔灯文库logo

下载提示:1. 本站不保证资源下载的准确性、安全性和完整性,同时也不承担用户因使用这些下载资源对自己和他人造成任何形式的伤害或损失。
2. 本文档由用户上传,版权归属用户,大桔灯负责整理代发布。如果您对本文档版权有争议请及时联系客服。
3. 下载前请仔细阅读文档内容,确认文档内容符合您的需求后进行下载,若出现内容与标题不符可向本站投诉处理。
4. 下载文档时可能由于网络波动等原因无法下载或下载错误,付费完成后未能成功下载的用户请联系客服处理。

相关文档

  • VHDL.docx

    library ieeeuse _logic_use _logic_entity fenpin isport( clk40M: in std_logic clk1hzclk1000hz: out std_logic ) end fenpin architecture one of fenpin is signal a: integer ra

  • VHDL源程序.doc

    LIBRARY IEEEUSE _LOGIC_USE _LOGIC_ENTITYT10 IS PORT (CLK: IN STD_LOGIC CLR: IN STD_LOGIC ENB: IN STD_LOGIC OUTY: OUT STD_LOGIC_VECTOR(3 DOWNTO 0) COUT: OUT S

  • .doc

    实验4二十四进制计数器设计一 实验目的1.熟悉QuartusII的VHDL文本设计流程全过程学习计数器的设计与仿真2.掌握简单逻辑电路的设计方法与功能仿真技巧3 学习使用VHDL语言进行二十四进制计数器的设计二. 实验仪器设备 1 PC机1台 2 QuartusII系统1套三.实验原理1 参考二十四进制计数器设计中的相关内容2 根据老师教学演示的相关内容四.实验内容用VHDL语言设计一个二十四进制

  • 实验-基于HDL.doc

    #

  • 秒分时字电子钟__六秒分(或).doc

    数字电子钟是一种用数字显示秒分时日的计时装置与传统的机械钟相比它具有走时准确显示直观无机械传动装置等优点因而得到了广泛的应用小到人们日常生活中的电子手表大到车站码头机场等公共场所的大型数显电子钟数字电子钟由以下几部分组成:秒脉冲发生器校时电路六十进制秒分计数器二十四进制(或十二进制)计时计数器秒分时的译码显示部分等 设计总体思路

  • .doc

    十二进制计数器附录1:实验电路图附录2:元器件清单仪器名称型号数量用途同步十进制计数器74LS160 2片级联构成其他进制计数器 与门 或门 非门74LS08D74LS32D74LS04D各1个辅助设计构成其他计数器共阴极显示器DCD-HEX2只显示数字计数电压源Vcc 5v1个提供电压译码器74LS1482个译码 : PAGE 2

  • .doc

    Xilinx FPGA实验报告——十二进制同步计数器十二进制同步计数器实验内容用BCD码实现个位和十位 其中个位十进制十位二进制当计数到11时产生进位脉冲自行设计VHDL测试向量文件进行仿真测试分频产生1Hz信号用1Hz信号作为十二进制同步计数器的计数时钟设计数码管译码电路将计数结果在BASYS2实验板上下载显示实验目的熟悉Xilinx的ISE软件的使用和设计流程掌握ISE仿真方法熟悉Xilinx

  • .doc

    郑州科技学院《数字电子技术》课程设计题 目 十二进制计数器 学生 丁洪宝 专业班级 电科一班 学 号 201031018 院 (系) 电气工程学院 指导教师 袁玉霞 完成时间 2013年03月15日 : PAGE  : 目 录 TOC o 1-2 h z

  • vHDL用jk触发异步假发.doc

    LIBRARY IEEEUSE _LOGIC_USE _LOGIC_ENTITY SCAN_LED IS PORT ( d : IN STD_LOGIC_VECTOR(3 DOWNTO 0) SG :OUT STD_LOGIC_VECTOR(6 DOWNTO 0)

  • 24VHDL语言.doc

    24进制计数器设计VHDL语言:LIBRARY IEEEUSE _LOGIC_USE _LOGIC_USE _LOGIC_ENTITY ESJZ ISPORT(CLK :IN STD_LOGIC --时钟EN :IN STD_LOGIC --使能端CR :IN STD_LOGIC --清零端低电平有效LD :IN STD_LOGIC --数据载入控制低电平有效D :IN STD_LOGIC_

违规举报

违法有害信息,请在下方选择原因提交举报


客服

顶部